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ADE7854/ADE7858/ADE7868/ADE7878
Data Sheet
TIMING CHARACTERISTICS
VDD = 3.3 V ± 10%, AGND = DGND = 0 V, on-chip reference, CLKIN = 16.384 MHz, T MIN to T MAX = ?40°C to +85°C. Note that dual
function pin names are referenced by the relevant function only within the timing tables and diagrams; see the Pin Configuration and
Function Descriptions section for full pin mnemonics and descriptions.
Table 3. I 2 C-Compatible Interface Timing Parameter
Standard Mode
Fast Mode
Parameter
SCL Clock Frequency
Hold Time (Repeated) Start Condition
Low Period of SCL Clock
High Period of SCL Clock
Set-Up Time for Repeated Start Condition
Data Hold Time
Data Setup Time
Rise Time of Both SDA and SCL Signals
Fall Time of Both SDA and SCL Signals
Symbol
f SCL
t HD;STA
t LOW
t HIGH
t SU;STA
t HD;DAT
t SU;DAT
t R
t F
Min
0
4.0
4.7
4.0
4.7
0
250
Max
100
3.45
1000
300
Min
0
0.6
1.3
0.6
0.6
0
100
20
20
Max
400
0.9
300
300
Unit
kHz
μs
μs
μs
μs
μs
ns
ns
ns
Setup Time for Stop Condition
Bus Free Time Between a Stop and Start Condition
Pulse Width of Suppressed Spikes
t SU;STO
t BUF
t SP
4.0
4.7
N/A 1
0.6
1.3
50
μs
μs
ns
1
N/A means not applicable.
SDA
t F
t SU;DAT
t HD;STA
t SP
t R
t BUF
SCLK
t LOW
t R
t F
START
CONDITION
t HD;STA
t HD;DAT
t HIGH
t SU;STA
REPEATED START
CONDITION
t SU;STO
STOP
START
CONDITION CONDITION
Figure 5. I 2 C-Compatible Interface Timing
Rev. H | Page 12 of 100
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